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随着集成电路的发展、FPGA结构与功能的改变，基于FPGA的开发模式也发生了很多变化。从传统使用单一的逻辑编程，发展到如今在SOC上大量使用各种知识产权核（IP核）进行设计。特别是在2011年，Xilinx推出了Zynq7000首款可扩展处理平台（EPP）[1]，将业界标准的ARM双核CortexA9 Core处理系统与Xilinx可扩展的28nm FPGA架构整合在一起。因此，可以预见未来的开发模式将为“嵌入式+FPGA”。文献[2]、[3]提出了基于AXI总线的IP核设计，但其仅采用AXI总线中的AXI4接口，而在一些对速率要求比较苛刻的项目中，所用IP核的接口必须是更为高效的AXIStream接口。在设计加密IP核的同时，需要结合实际IP核所要运用的项目场景，考虑外围可能连接的IP核，最大化地使用官方IP核，进行自定义IP核的最优化设计，而这些在目前许多加密IP核设计中很难找到。